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      LATTICE和ALDEC宣布將在FPGA設計和驗證領域進行新的合作,實現混合語言仿真

      發布日期:2022-07-15 點擊率:71

      Lattice半導體公司及其合作公司Aldec日前宣布了一項新的OEM協議,Aldec將會發布其唯一一款混合語言OEM FPGA仿真器。Active-HDL的Lattice版本將和Lattice的ispLEVER設計工具套件捆綁出售,提供混合語言(VHDL, Verilog和SystemVerilog)仿真,和MathWorks的simulink的協同仿真及其他Lattice加密IP核的相關仿真支持等。

      “和Lattice合作并和Lattice的FPGA解決方案捆綁銷售我們強大的混合語言仿真器令我們感到非常興奮,”Aldec的營銷副總裁David Rinehart說道,“Active-HDL 的Lattice版本來自一個經過業界驗證的FPGA解決方案,該方案提供了良好的性能和強大的功能,已經有越來越多的Lattice FPGA設計人員要求采用此方案以有效地驗證他們的設計。”

      負責企業方案的公司副總裁Chris Fanning說道,“我們和Aldec的聯盟將使Lattice能夠通過捆綁ispLEVER設計開發套件提供特殊的設計驗證能力,為客戶提供無可比擬的價值。我們的結盟是Lattice向我們的FPGA客戶提供業界領先的解決方案的使命的又一個里程碑。”

      關于Active-HDL的Lattice版

      Active-HDL的Lattice版對Lattice 的設計擁有良好的仿真特性,混合語言的支持并能提高從波形圖測試到和MathWorks Simulink協同仿真這一過程的效率。

      Active-HDL Lattice Web版只針對一種語言仿真,VHDL或者Verilog,并且只支持比較小型的設計及ispLEVER Starter和ispLEVER Classic工具所支持的典型器件。


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