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      產(chǎn)品分類(lèi)

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      科普知識(shí)
      數(shù)據(jù)分類(lèi):
      FFC連接器

      如何保證多相智能功率級(jí)應(yīng)用中的信號(hào)完整性

      發(fā)布日期:2022-04-20 點(diǎn)擊率:22


      1.前言

      雖然適當(dāng)?shù)拇箅娏鞴β始?jí)布局在 DC/DC 應(yīng)用中始終很重要,但在印刷電路板 (PCB) 布局期間注意穩(wěn)壓器信號(hào)路由比以往任何時(shí)候都更加重要。流行的 PMBus協(xié)議的修訂版 1.3帶來(lái)了更快的 1MHz 時(shí)鐘速度以及高速 50MHz AVSBus 選項(xiàng)。這些數(shù)字線(xiàn)路以及與每個(gè)穩(wěn)壓器相位相關(guān)的快速邊沿脈寬調(diào)制 (PWM) 信號(hào)必須正確布線(xiàn),以避免妨礙當(dāng)今應(yīng)用不斷提高的模擬性能要求。添加智能功率級(jí)為了將輸出電流和 FET 溫度報(bào)告回控制器,我們還必須在 PCB 布局中考慮更多的模擬檢測(cè)線(xiàn)。如何保持一切正常可能是工程師的噩夢(mèng)。

      2.具體方案

      圖 1 顯示了一個(gè)使用TPS53667 控制器和CSD95490Q5MC 智能功率級(jí)的六相降壓穩(wěn)壓器,其中快速邊沿信號(hào)以紅色突出顯示,敏感模擬運(yùn)行以綠色突出顯示。在理想情況下,PWM1 到 PWM6 和 PMBus 線(xiàn)將放置在與電流、電壓和溫度感測(cè)跡線(xiàn)不同的層上,中間有一個(gè)屏蔽接地層。然而,在空間受限的應(yīng)用中,這種分離并不總是可行的,在這種情況下我們必須注意的一件事是串?dāng)_。

      如何保證多相智能功率級(jí)應(yīng)用中的信號(hào)完整性

      圖 1:使用 TPS53667 和智能功率級(jí)的多相降壓穩(wěn)壓器

      當(dāng)并行布線(xiàn)兩條走線(xiàn)時(shí),兩者之間會(huì)發(fā)生一定量的耦合——電容性、電感性或兩者兼而有之。在數(shù)字系統(tǒng)中,應(yīng)該有足夠的噪聲容限來(lái)防止任何類(lèi)型的損壞,但是當(dāng)噪聲 PWM 信號(hào)被路由到模擬電流檢測(cè)走線(xiàn)旁邊時(shí),如圖 2 所示,電流監(jiān)控系統(tǒng)的精度會(huì)受到影響.

      在最好的情況下,控制器會(huì)向系統(tǒng)報(bào)告錯(cuò)誤的電流讀數(shù)。在最壞的情況下,串?dāng)_嚴(yán)重到足以觸發(fā)錯(cuò)誤的過(guò)流事件并關(guān)閉系統(tǒng)。如果 V OUT感測(cè)線(xiàn)布線(xiàn)不正確,則可能會(huì)對(duì)調(diào)節(jié)精度和環(huán)路穩(wěn)定性產(chǎn)生負(fù)面影響。

      如何保證多相智能功率級(jí)應(yīng)用中的信號(hào)完整性

      圖 2:不正確的路由示例

      串?dāng)_受許多參數(shù)的影響,包括走線(xiàn)間距、屏蔽平面上方或下方的高度、信號(hào)上升時(shí)間以及信號(hào)并行布線(xiàn)的長(zhǎng)度。對(duì)于 TPS53667,控制器設(shè)計(jì)設(shè)置 PWM 邊沿時(shí)間,而 PMBus 規(guī)范設(shè)置通信線(xiàn)路的上升時(shí)間。由于這是一個(gè)空間受限的應(yīng)用,我們假設(shè)我們無(wú)法將 PWM 和電流檢測(cè)引腳 (CSP) 走線(xiàn)移動(dòng)到不同的層。這使得走線(xiàn)的間距和 FR4 的厚度成為唯一可用于最小化串?dāng)_的處理。參見(jiàn)圖 3。

      如何保證多相智能功率級(jí)應(yīng)用中的信號(hào)完整性

      圖 3:微帶線(xiàn)(左)和帶狀線(xiàn)(右)布局示例

      由于走線(xiàn)間距和高度各不相同,我們可以從圖 4 中得出幾個(gè)關(guān)鍵結(jié)論,以對(duì)抗串?dāng)_并提供最佳布局。目標(biāo)是盡可能地最大化走線(xiàn)之間的間距,同時(shí)使層厚度盡可能薄,以達(dá)到晶圓廠的限制條件。將走線(xiàn)限制在內(nèi)部層以創(chuàng)建帶狀線(xiàn)也減少了走線(xiàn)之間的耦合。最后,為了獲得最佳性能并防止不必要的串?dāng)_,請(qǐng)?jiān)诟咚傩盘?hào)和檢測(cè)線(xiàn)之間放置接地跡線(xiàn)或接地填充物,只要它們彼此平行,如圖 5 所示。

      如何保證多相智能功率級(jí)應(yīng)用中的信號(hào)完整性

      圖 4:微帶(左)和帶狀線(xiàn)(右)布局的串?dāng)_系數(shù)(以分貝為單位)

      如何保證多相智能功率級(jí)應(yīng)用中的信號(hào)完整性

      圖 5:優(yōu)化布局示例

      通過(guò)適當(dāng)?shù)囊?guī)劃和一點(diǎn)運(yùn)氣,我們的下一個(gè)轉(zhuǎn)換器布局將不會(huì)像本文中顯示的示例那樣受到限制。盡管如此,仍應(yīng)考慮信號(hào)完整性和串?dāng)_最小化的重要性。

      3.PCB布局技巧

      在PCB的布局設(shè)計(jì)中要分析電路板的單元,依據(jù)起功能進(jìn)行布局設(shè)計(jì),對(duì)電路的全部元器件進(jìn)行布局時(shí),要符合以下原則:

      1、按照電路的流程安排各個(gè)功能電路單元的位置,使布局便于信號(hào)流通,并使信號(hào)盡可能保持一致的方向 。

      2、以每個(gè)功能單元的核心元器件為中心,圍繞他來(lái)進(jìn)行布局。元器件應(yīng)均勻、整體、緊湊的排列在PCB上,盡量減少和縮短各元器件之間的引線(xiàn)和連接。

      3、在高頻下工作的電路,要考慮元器件之間的分布參數(shù)。一般電路應(yīng)盡可能使元器件并行排列,這樣不但美觀,而且裝旱容易,易于批量生產(chǎn)。

      4、在通常情況下,所有的元件均應(yīng)布置在電路板的同一面上,只有頂層元件過(guò)密時(shí),才能將一些高度有限并且發(fā)熱量小的器件,如貼片電阻、貼片電容、貼片IC等放在低層。

      5、在保證電氣性能的前提下,元件應(yīng)放置在柵格上且相互平行或垂直排列,以求整齊、美觀,在一般情況下不允許元件重疊;元件排列要緊湊,元件在整個(gè)版面上應(yīng)分布均勻、疏密一致。

      6、電路板上不同組件相臨焊盤(pán)圖形之間的最小間距應(yīng)在1MM以上。

      7、離電路板邊緣一般不小于2MM.電路板的最佳形狀為矩形,長(zhǎng)寬比為3:2或4:3.電路板面尺大于200MM乘150MM時(shí),應(yīng)考慮電路板所能承受的機(jī)械強(qiáng)度。





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